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在 2 纳米及以下工艺水平，摩尔定律意味着更多，但更多也意味着更少。

表面上，在光刻胶大小的芯片上集成的晶体管越多，芯片处理数据以及在存储器和芯片之间往复传输数据的速率就越快。但表面与现实正在出现偏差。

从历史上看，达成这一方向的最好智力是缩小晶体管、导线和存储单位的尺寸。但在 2 纳米及以下制程工艺下，这种智力靠近严峻挑战。导线相等细，导致 RC 延长成为一个首要难题。动作缓存主要技能的 SRAM 尺寸缩小，在数字逻辑电路的缩小方面远远逾期。这反过来又收尾了单个光罩大小的芯片上可容纳的存储容量。此外，由于工艺偏差，在晶圆厂中达成交流的良率也变得愈加困难，因为工艺偏差可能出当今数百以至数千个插入点以及制造过程中使用的数十种用具上。

任何制造工艺王人存在一定进度的偏差，但在2纳米制程中，偏差的进度偏激成因王人在加多。由于金属层和衬底越来越薄，容易发生翘曲，导致凸点无法全王人一语气；此外，为确保芯片可靠性而需要的数十谈工序也可能放松或损坏脆弱的互聚合构或材料。芯片制造斥地本人存在偏差，原材料和晶圆也相同如斯。其恶果是，天然芯片上的晶体管和互连数目更多，但弱势率也更高。本钱上升，良率着落。

Synopsys工程副总裁 Abhijeet Chakraborty 默示：“东谈主们期许尺寸缩小后，器件性能会更快、功耗更低、晶体管密度更高。但挑战在于能否达成这些方向。能否达成性能晋升 10% 到 15%，功耗裁汰 20% 到 30%？对于好多小心每瓦性能和晶体管密度的应用来说，更低的功耗极具劝诱力。但能否作念到这一丝呢？这其中蕴含着诸多挑战和考量。试验应用中，良率和可制造性王人靠近着诸多挑战。”

制造工艺是一个束缚完善的过程。跟着时辰的推移，工艺束缚矫正，使得代工场能够放宽那些为每项前沿工艺预留裕量的严格联想司法，也使得EDA和斥地供应商能够针对每项工艺制定相应的司法和例外情况。最初，只是是让这些先进节点联想能够泛泛运行本人便是一项工程豪举，而早期版块频繁是针对最坏情况联想的，其中包含冗余晶体管、互连线以及弥散的内置自测试功能，以便在必要时再行路由数据和处理过程。

但这种利润空间会占用庄重的面积资源，收尾性能和能源方面的投资讲述。

“在2nm和18A工艺中，裕量已成为最受诟病的资源之一，” proteanTecs首席技能官Evelyn Landman默示。“裕量必须足以莽撞工艺偏差、热效应和环境影响、使命负载压力、潜在弱势以及老化等问题。将通盘这些成分汇总到一个单一的最坏情况保护带中已不再可行。静态保护带会阵一火性能和功耗，况且仍然无法扞拒试验应用环境中的各式挑战。独一可执续的智力是平直测量保护带，即在试验使命负载下，以高笼罩率及时监测时序裕量，并在产物质命周期内执续管理。其中枢念念想是平直监测时序裕量，而不是通过转折智力。”

跟着工艺的训诲，不错在保执可袭取良率的前提下减少裕量。但对于5nm以下的每个新节点，尤其是2nm及以下节点，达成这一方向所需的时辰越来越长。尽管16/14埃节点正在研发中，10埃（非常于1nm）节点的研发使命也已启动，但从5nm之后的每个节点运行，达到足以心仪大限制量产良率要求的量产所需的时辰王人在延长。

英特尔逻辑技能副总裁兼总司理 Ben Sell 默示：“14A 之后，下一个长途的制程节点是 10A。咱们依然在研发这个节点了，但节点称呼本人并不长途，长途的是它能否心仪客户的需求。咱们频繁会先详情一个基础节点。咱们会为少数几个最长途的客户界说一个基础节点。咱们称这些客户为‘界说型客户’，节点便是把柄他们的需求来界说的。要是这个节点心仪了咱们主要客户的需求，那么在与更多客户和解时，咱们可能会对这个节点进行一些修改。比如加多几层金属层，或者进行一些小的改换，以心仪特定产物的需求。但这些改换幅度相对较小，因为咱们但愿确保通盘已开发的 IP 王人能在芯片上使用，这么就无需再行联想依然过考据和测试的 IP。”

10A节点很可能是临了一个采取环栅场效应晶体管（GAA）的节点（尽管业界历来王人有将技能推向超出预期水平的前例）。拔帜树帜的是互补型场效应晶体管（FET） ，前后可能出入一两个节点，这种晶体管勾搭了在不同晶圆上开发的nFET和pFET。

“CFET 是一种器件架构，” Lam Research的首席东谈主工智能官兼 Semiverse Solutions 公司副总裁 David Fried 默示，“与 FinFET 和环栅 FET 比拟，它加多了前端的复杂性和挑战。结构愈加复杂，触及的材料也更多。这些材料之间的距离将比以往任何时候王人更近。但 CFET 的趣味趣味之处在于，从平面到 FinFET 再到环栅，咱们的 nFET 和 pFET 一直王人是横向相邻的。而对于 CFET 来说，它们将凹凸堆叠。这带来了普遍的结构复杂性，以及咱们畴昔从未见过的互连复杂性。举例，好多后头的电源分派必须洽商到 nFET 和 pFET 是凹凸堆叠而不是相邻的。因此，博亚体育app官方网站CFET 的复杂性将浸透到该技能的好多其他方面。它不单是是晶体管的改进。”

图 1：CFET，娇傲了 nFET 和 pFET 的位置

经济风景的变化，加速了改进

东谈主工智能数据中心的大限制建造和部署，从根蒂上改变了2纳米及以下制程芯片的联想和制造方法。天然从功耗角度来看，芯片尺寸的缩小仍然被视为上风，性能方面也有一定进度的晋升，但光罩尺寸的芯片上可用的空间不及以处理生成式东谈主工智能和智能东谈主工智能所需的无数数据。因此，与其试图将通盘功能王人塞进单个芯片，不如将要点转向多芯片封装的芯片组，尽管称呼如斯，但这些芯片组的尺寸不错与光罩尺寸交流。

这带来了一系列新的量度采取。对于定制化高等封装中的多个芯片而言，面积不再是主要问题，但数据的编排和传输却变得极具挑战性。分解东谈主工智能操办是一个复杂的、大限制并行操作，其中处理过程可能被分派到不同的处理单位，最终将恶果合并。自 IBM 在 20 世纪 80 年代初次大限制并行处理以来，临了一步一直是个难题。

开首，将所特殊据同期移动到正确的位置极其困难。任何处理单位的延长，或因使命负载特定的热梯度导致的一条或多条数据旅途的不均匀老化，王人可能裁汰通盘这个词系统的性能。此外，在20埃或更小的距离下，驱动芯片间长距离信号所需的电阻会加多功耗，从而导致封装里面温度升高。要害在于详情这些多芯片组件将若何诈欺特定的使命负载，因为这会影响封装里面热量的积聚位置。跟着使命负载的变化，热量也会随之升沉。这会导致热门的出现，进而加速电迁徙，最终可能减缓以至全王人阻断数据传输。

“使命负载如今已成为首要的联想敛迹条目，”proteanTecs公司的兰德曼默示。“长途的不仅是操办量的使用，还有操办量随时辰推移的使用形式。大型言语模子考试和推理模式会在芯片上变成高度不均匀的压力。即使是交流的芯片，瞬时峰值、局部热门和万古辰的压力模式也会产生霄壤之别的恶果。忽略使命负载活动的联想要么会过度敛迹，要么会在试验应用中显得脆弱。”

跟着芯片冉冉演变为由一语气到某种中介层的袖珍芯片构成的聚合体，这一丝变得尤为长途。此外，为了使用更细的导线在更长的距离上传输更多数据，还需要进行其他方面的矫正。在首先进的工艺节点上，IM体育官方网站首页需要采取新的材料和工艺，以提高先进封装里面以及封装之间长距离传输电子（最终也包括光子）的迁徙率，同期还要提高结构领会性，并减少2.5D和3.5D结构中的翘曲。

“从高介电常数材料和金属栅极到用于应力源的硅锗，材料改进指不胜屈，”Lam Research 的 Fried 说。 “跟着先进逻辑晶体管的发展，咱们大要每十年就会看到几项材料改进。在我目下的使命中——我触及逻辑器件、DRAM、NAND、好多不同的专科商场以及先进封装——这种改进是执续束缚的。从钨到钼的过渡依然在NAND和DRAM字线以及底层逻辑互连中发生。从钴到钌的过渡似乎还要过一段时辰，但咱们将在底层互连和布线等特定边界看到它的应用。你不错不雅察任何一项材料过渡，并发现它在多个不同技能边界——逻辑、DRAM和专科先进封装——的交织点。这些过渡正在各个边界发生。专科技能边界令东谈主无比简洁。举例集成光子学。咱们商量集成光子学依然很深切，但这些大型东谈主工智能系统实在股东了东谈主们对集成光子学的更多关切。集成光子学的材料选拔可能相等复杂，因此该边界将会出现材料过渡。”

在这么的尺寸下，限制经济和可相通性变得愈发长途。从2008年运行，芯片行业入辖下手将晶圆尺寸从300毫米过渡到450毫米，以期在一派晶圆上制造更多芯片，从而对消束缚高潮的研发本钱。但是，由于其时能够从450毫米晶圆中获益的公司数目不及，这项预备于2017年被遗弃。

自那时以来，商场依然发生了变化。当今有四家最初的晶圆厂——英特尔晶圆厂、台积电晶圆厂、三星晶圆厂，以及新加入的Rapidus晶圆厂——同期，由于东谈主工智能的发展，东谈主们对更高性能的需求也永无终点。

只是提高时钟频率已不再可行，因为这会毁灭芯片，因此业界选拔了采取多芯片决策，即芯片组（chiplet）。制造通盘这些芯片组最经济的智力是使用大型矩形面板，而不是300毫米圆形晶圆。这与转向450毫米晶圆的旨趣交流，只是局势和尺寸不同，况且动作被迫基板。矩形尺寸比圆形晶圆能容纳更多的芯片，而且工艺更容易圭臬化，而无需像从大型圆形晶圆中榨取更多可用面积那样勤快。英特尔实验室以至提议了面板级芯片决策，该决策基本上是将Cerebras开发的晶圆级决策扩展到500 x 500毫米的全尺寸面板上。

但是，这种变化的幅度令东谈主回避而视。它需要全新的斥地和不同的薄晶圆处明智力，这绝非易事。此外，由于机械应力，最大偏差区域也从晶圆边际升沉到了面板中心。

Rapidus封装技能现场首席技能官Rozalia Beica默示：“圆形晶圆仍将是初期阶段，更多地应用于2.5D硅中介层。但即便如斯，由于光罩尺寸的收尾，业界也已运行转向面板封装。面板封装的产能将更高。这试验上取决于中介层的尺寸以及咱们将要坐褥的封装类型，但咱们将在消除家晶圆厂完成封装和硅芯片的制造。咱们无需将芯片运载到其他晶圆厂或其他国度进行封装。”夹杂键合技能也正在闹热发展。Beica补充谈：“这些芯片将采取晶圆级封装（DUIW）。晶圆级封装更稳健夹杂存储器，但当器件尺寸不同期，晶圆级封装（DUIW）会更合适——但也更具挑战性。”

图 2：芯片封装结构的演变

更丰富的定制化决策

股东了先进制程节点的发展，其背后是财力浑朴的公司温情投资定制硅芯片以心仪其特定需乞降数据类型。Rapidus 的晶圆级芯片 (DIO) 和面板级芯片 (DIO) 技能达成了突出 2nm 电子传输通谈的定制化。与此同期，英特尔晶圆代工 (Intel Foundry) 将该传输通谈集成到基层金属层中，然后提供异常的金属层以供定制，以及各式互连形式，举例桥接。台积电 (TSMC) 则通过其名为 NanoFlex 的技能，在其圭臬单位架构中提供无邪性。三星预备提供一种定制的 HBM，从不同的角度晋升性能。最终，每家晶圆代工场王人会找到最稳健我方的决策，很可能是多种智力的组合。

“通用平台将会存在，但专诚旨的定制化仍将保留，”proteanTecs公司的兰德曼默示。“不同的商场喜欢不同的量度采取。跟着定制化进度的提高，联想意图、芯片试验情况、封装性能和系统运行之间快速关联的需求变得至关长途。恰是这种响应轮回使得先进工艺节点能够突出早期采取者，达成限制化应用。”

高速地对数据进行优先级排序、分类和传输至关长途。在平面SoC中，从芯片一角向另一角发送信号仍然比通过中介层将信号传输到芯片外更快。事实上，在先进封装中达成雷同速率的独一智力是使用全3D集成电路，这种集成电路不错进行布局有预备，使要害数据需要传输的距离比平面SoC更短。目下，这种智力已应用于HBM存储器堆栈下方的逻辑层，但DRAM堆栈能否达到或接近SRAM的速率还有待不雅察。此外，由于散热和偏差商酌的问题，全3D集成电路在其他应用中是否具有本钱效益也尚不解确。

光子学省略能提供一个可行的过渡决策。近期对于将光波导镶嵌玻璃基板的商量标明，这种智力不错显耀加速数据传输速率，且产生的异常热量极少。其靠近的挑战包括：若何谛视玻璃开裂、如安在狭隘空间内将光信号退换为电信号，以及若何莽撞热致光漂移。值得行运的是，好多玻璃和硅的热扩张所有大致交流。

光学技能在多个边界进展着越来越长途的作用。掩模写入技能的逾越使得在晶圆上印刷各式局势（包括多边形和弧线局势）的精度大大提高。

英特尔的塞尔默示：“咱们正在相等仔细地商酌弧线局势。这是一种量度，因为操办这些弧线局势的本钱更高，但精度也更高。是以这取决于你需要多高的精度，因为微调也需要异常的本钱。”

另一种选拔是高数值孔径（NA）的极紫外（EUV）光刻技能。“Intel 18A 的联想允许咱们使用单次 EUV 光刻，这相等棒，”Sell 说。“但瞻望改日，咱们将不得不采取屡次 EUV 光刻，而这恰是用单次高 NA EUV 光刻替代屡次低 NA EUV 光刻的契机地方。咱们目下正在 Intel 14A 上进行这方面的商酌。咱们依然制定了联想司法，以便能够同期使用这两种技能。但跟着时辰的推移，要是能够用单次高 NA 光刻替代低 NA EUV，就能简化工艺经过并裁汰本钱。咱们对 14A 的各式决策执怒放魄力。咱们知谈低 NA EUV 光刻也能达成。而高 NA EUV 光刻则提供了裁汰本钱的契机。”

另一种选拔是在多芯片组件中组合不同类型的单位，这不错进一步裁汰本钱。“IP是联想的要害构成部分，天然，IP是针对特定技能节点（举例2纳米）进行优化的，”Synopsys公司的Chakraborty默示。“因此，通过这种夹杂联想理念，您不错夹杂搭配不同的圭臬单位。您不错将高性能圭臬单位与低功耗圭臬单位以及高密度圭臬单位夹杂使用。当今有更多类型的圭臬单位可供选拔，而用具必须相等智能地选拔它们，才能最大限制地进展其上风。要是您为了心仪高性能操办AI联想中相等高的性能方向而到处使用高性能圭臬单位，那么您将付出功耗和其他预备方面的代价。但这种夹杂使用相等长途。”

论断

组件的混搭组合将要点从缩极少字逻辑尺寸升沉到数据传输。所谓的“突出摩尔定律”联想是达成东谈主工智能/高性能操办数据中心以及改日高性能边际操办性能方向的独一路线。在许厚情况下，它们还能加速产物上市速率，因为它们诈欺了半导体制造边界数十年的警戒积聚。

“咱们仍然会采取平面加工工艺，”弗里德说谈。“咱们仍然会将晶圆放入斥地中，处理晶圆上表露的通盘内容。每个工艺王人有其参数、变异性和商酌的测量技能。这些王人会浸透到你构建的任何结构中。工艺、参数和要害性能预备王人会更多。但是，领路这些变异性若何浸透到技能中、它们若何相互作用、以及在那边需要限度它们的基本数学旨趣并莫得改变。数学操办量确乎加多了，但实质上并莫得改变。当技能还比较轻便的时候，咱们知谈这些数学旨趣，况且咱们进行了通盘这些操办。咱们最初是在脑海中进行操办，然后咱们开发了一些相对轻便的系统来达成这些操办。但当今工艺和参数如斯之多，咱们必须使用先进的系统，以及维持这些系统的物理模子或虚构硅，才能理清通盘这些数学操办。”

（来源：编译自semiengineering ）

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